随着 5G、6G 通讯与人工智慧运算快速发展，对电子元件的效能与能效要求越来越高。传统矽材料虽然成熟且成本低廉，但在高频与高功率应用中逐渐显露瓶颈。氮化镓GaN凭借其高速与高效率特性，被视为下一代关键半导体材料，却因制程昂贵与整合困难，长期受限于商业化进程。近期，麻省理工学院研究团队提出一种全新的低成本制造方法，成功将 GaN 电晶体与标准矽 CMOS 晶片完美结合，为高速通讯与先进运算技术开启全新可能。
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氮化镓的重要性与挑战
氮化镓（Gallium Nitride, GaN）被誉为仅次于矽的第二热门半导体材料，凭借其高效率与高速特性，广泛应用于照明、雷达系统、电力电子与先进通讯设备。然而，将 GaN 高性能电晶体整合至传统矽 CMOS 晶片却长期面临成本与工艺上的瓶颈。传统焊接方法限制了 GaN 电晶体的缩小与性能发挥，而整片 GaN 晶片的整合则造成巨额成本浪费，使其商业化进程受阻。
MIT的创新解方：3D积层技术
MIT 团队提出的创新方法，突破了以往「整片转移」或「焊接黏合」的限制，采用 低成本、可扩展的三维积层技术（3D Integration）。其核心概念是将 GaN 功能切割成许多「微型电晶体单元」，再将其分散配置于矽晶片上。
这种「模组化整合」策略，避免了传统制程中大量 GaN 材料的浪费，也让 GaN 仅在最需要的关键元件中发挥作用。由于 GaN 单元的面积极小，整合过程中的应力、温度需求与成本都大幅下降，使技术更容易规模化量产。
同时，这种三维积层方式还兼容现有半导体代工流程，无需大幅修改生产线设备，降低了导入难度。这意味着，该技术不仅可推动学术研究，也能实际进入商业化应用，为 5G、6G 甚至量子运算等领域铺路。
制程细节：微型电晶体与低温键合
该方法首先在 GaN 晶片上建构大量微型电晶体，并以雷射切割成约 240 x 410 微米大小的「小晶片（dielet）」。每个小晶片顶部设计有铜柱，可在低于摄氏 400 度的环境下，与矽晶片表面的铜柱直接键合。相较于传统依赖昂贵且高温的金制程，铜的应用降低了成本、应力与污染风险，同时提升导电效率。
系统效能提升与散热优势
这项整合方式的另一大优势，是 GaN 电路由分散在矽晶片上的离散电晶体组成，能有效降低系统整体温度。研究人员利用此方法开发出功率放大器，展现出比矽电晶体更高的讯号强度与效率。在智慧型手机应用中，这代表更佳的通话品质、更宽的无线频宽、更稳定的连接，以及更长的电池续航力。
对半导体产业的影响
由于该方法与标准半导体代工制程兼容，未来能直接应用于现有电子产品与下一代技术开发。这不仅有望加速 5G 与 6G 的通讯部署，也可能推动量子计算、人工智慧加速器以及资料中心的节能升级。 IBM 研究科学家更指出，这种异质整合路径正是应对摩尔定律放缓的重要解方，能实现持续系统微缩与功率效率优化。
展望未来
麻省理工学院研究生 Pradyot Yadav 表示：「我们成功将矽的成熟制程与 GaN 的高效能特性结合，这些混合晶片有潜力彻底改变许多产业。」这项研究已在 IEEE 射频积体电路研讨会上展示，未来随着工艺成熟，GaN 与矽的异质整合技术势必将推动高速、节能电子装置的普及。
资料来源:
- 新型 3D 晶片制造技术，使电子产品更快、更节能
- ew 3D chips could make electronics faster and more energy-efficient
(首图来源:麻省理工学院)
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